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摘要:随着工艺的进步,设计规模的增加,以及当前应用的需求,低功耗设计已经成为所有芯片的必然要求。由于时钟树占据芯片总功耗的很大的比例,本文从降低部分电路的时钟频率而又不损失整体芯片性能的角度来达到降低时钟功耗的目的。通过采用低频时钟交互,达到高频性能来实现该目的。实验结果表明本文的方法显著降低了整体功耗。
摘要:随着工艺技术的进步,如何降低功耗已经成为当前设计的关键。本文针对时钟树综合阶段从降低负载电容角度分别探讨了时钟树构建单元的选择及时钟网络拓扑结构的优化两种不同的设计方案。通过采用混合构建单元的使用与减小时钟树规模的思想对设计进行优化,实验结果表明本文的方法显著降低了整体功耗。
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